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岗位职责:
1. 负责CBB/Memory的生成与日常维护工作,
2. 开展vcs/verdi/lint/cdc/dft/check流程的脚本设计及持续优化。
3. 掌握python、tcl、shell等常用脚本编程语言。

任职要求:
1. 具备硕士研究生学历,专业方向为计算机、微电子、集成电路、人工智能等相关领域。
2. 具有扎实的数字电路基础知识,熟悉Verilog/SystemVerilog语言的使用。
2026-06-29 14:49
IP属地:上海

职位福利

硕士经验不限接受无数字前端设计师经验
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智辰半导体(深圳)有限公司
天使轮 · 100-499人
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