成都·武侯区
职位详情
工作职责:
作为视频编解码团队的核心成员，您将负责视频编码器/解码器相关IP的实现。具体职责包括但不限于：
•根据系统需求及算法，完成硬件实现的微架构设计。
•进行RTL数字电路设计及IP模块集成。
•参与模块级与系统级验证工作。
•协同后端团队完成综合、时序检查及功耗分析。
•撰写并评审设计规格文档。
任职资格:
•电子工程相关专业硕士或博士学位，具备至少3年相关领域工作经验。
•有视频编码器/解码器相关模块开发经验。
•深入理解视频压缩算法及相关标准（如AV1、H265、AVC、VP9、AVS/AVS2、MPEG1/2/4等）。
•熟练掌握Verilog/System Verilog语言，熟悉综合与时序收敛流程。
•具备C/C++、Perl使用经验者优先。
•有OVM/UVM使用经验者优先。
•具备良好的问题解决能力与沟通协作能力。
作为视频编解码团队的核心成员，您将负责视频编码器/解码器相关IP的实现。具体职责包括但不限于：
•根据系统需求及算法，完成硬件实现的微架构设计。
•进行RTL数字电路设计及IP模块集成。
•参与模块级与系统级验证工作。
•协同后端团队完成综合、时序检查及功耗分析。
•撰写并评审设计规格文档。
任职资格:
•电子工程相关专业硕士或博士学位，具备至少3年相关领域工作经验。
•有视频编码器/解码器相关模块开发经验。
•深入理解视频压缩算法及相关标准（如AV1、H265、AVC、VP9、AVS/AVS2、MPEG1/2/4等）。
•熟练掌握Verilog/System Verilog语言，熟悉综合与时序收敛流程。
•具备C/C++、Perl使用经验者优先。
•有OVM/UVM使用经验者优先。
•具备良好的问题解决能力与沟通协作能力。
2026-06-29 13:43
IP属地：四川成都
职位福利
硕士3-5年C++VerilogPerlcodec
晶晨芯半导体（成都）有限公司
未融资 · 100-499人
工作地址
鱼泡安全保障
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