合肥·蜀山区
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定义并搭建基于 UVM 的验证平台，开展针对数字与混合信号产品的验证工作
• 制定验证方案以覆盖产品规格书中的各项功能需求
• 协助生成用于模块级和全芯片级仿真的测试激励
• 运用逻辑仿真工具完成模块级及全芯片门级仿真的运行、结果分析与问题调试
• 在原型验证阶段协助进行芯片样片的调试与问题定位
• 掌握 I/O 时序规范，能够准确完成时序参数的验证
优先考虑的条件
• 具备 Verilog/System Verilog 编程实践经验
• 熟悉 UVM 验证方法学，具备较强的学习意愿
• 期望运用 UVM 框架独立构建数字验证环境
• 接触过 System Verilog 断言（SVA）者更佳
• 可读懂 RTL 层面的设计实现
• 具备良好的团队协作能力，能在紧凑的项目周期中高效推进任务
• 具有出色的书面与口头表达能力
• 主动积极，做事条理清晰，自我驱动性强
• 制定验证方案以覆盖产品规格书中的各项功能需求
• 协助生成用于模块级和全芯片级仿真的测试激励
• 运用逻辑仿真工具完成模块级及全芯片门级仿真的运行、结果分析与问题调试
• 在原型验证阶段协助进行芯片样片的调试与问题定位
• 掌握 I/O 时序规范，能够准确完成时序参数的验证
优先考虑的条件
• 具备 Verilog/System Verilog 编程实践经验
• 熟悉 UVM 验证方法学，具备较强的学习意愿
• 期望运用 UVM 框架独立构建数字验证环境
• 接触过 System Verilog 断言（SVA）者更佳
• 可读懂 RTL 层面的设计实现
• 具备良好的团队协作能力，能在紧凑的项目周期中高效推进任务
• 具有出色的书面与口头表达能力
• 主动积极，做事条理清晰，自我驱动性强
2026-09-25 13:19
IP属地：安徽合肥
职位福利
本科5-10年VerilogIC验证VHDLUVMverification
合肥睿科微电子有限公司
20-99人
鱼泡安全保障
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