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定义并搭建基于UVM的验证平台,开展数字与混合信号产品的验证工作
制定覆盖产品规格功能的验证方案
协助生成模块级及全芯片层级的测试激励向量
利用逻辑仿真工具完成模块级和全芯片门级仿真的运行、结果分析与问题调试
在原型开发阶段协助进行芯片实物的测试与问题排查
掌握I/O时序规范,能够准确验证相关时序参数

优先考虑的条件
具备Verilog/SystemVerilog编程经验
熟悉UVM验证方法学,具备主动学习意愿
期望运用UVM框架独立构建数字验证系统
接触过SystemVerilog断言语言
可读懂RTL级设计实现代码
具备良好的团队协作能力,能在紧凑进度下高效推进任务
出色的书面表达与口头沟通技巧
积极主动,做事有计划性和条理性
2026-08-08 12:52
IP属地:安徽合肥

职位福利

本科5-10年VerilogIC验证VHDLUVMverification
企业发布信息图
合肥睿科微电子有限公司
20-99人
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