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SOC IP及子系统设计工程师
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集成电路IC设计3-5年本科VerilogFPGA开发DSP开发射频开发电路设计芯片设计ARM开发
SOC芯片设计工程师(总线架构)
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数字前端设计师5-10年本科高速总线协议5年以上数字前端设计经验SoCVerilog/System Verilog总线方向有数字前端设计师经验SOC设计
ASIC 高级验证工程师(5G DFE&
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数字IC验证工程师5-10年本科Verilog半导体技术PerlIC验证基带芯片芯片设计
IC设计工程师(HAC)
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数字前端设计师经验不限硕士C/C++ASIC高速总线协议VHDL1-3年数字前端设计经验RISC-V1年以内数字前端设计经验Verilog/System Verilog有数字前端设计师经验ARM
SOC芯片设计工程师(总线方向)
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数字前端设计师5-10年本科高速总线协议5年以上数字前端设计经验SoCRISC-VCPU高速接口Verilog/System Verilog有数字前端设计师经验