杭州·西湖区
职位详情
工作职责:
负责芯片的RTL signoff、逻辑综合、DFT设计、形式验证、自动布局布线、寄生参数提取、时序分析、压降分析、ESD分析、DRC/LVS、特定电路仿真等。
任职资格:
1.本科及以上学历，电子相关专业，具备良好的沟通协调能力；
2.熟悉CMOS集成电路设计及制造流程；
3.能读懂Verilog语言设计的RTL代码；
4.熟练使用数字后端常用EDA工具，包括DC、ICC、StarRC、PT、Calibre等；
5.熟练使用Perl、TCL、python等一门或多门脚本语言；
6.具有以下条件优先考虑：28nm以上流片经验、懂综合DFT实现、具备ESD设计能力、充分了解封装工艺。
负责芯片的RTL signoff、逻辑综合、DFT设计、形式验证、自动布局布线、寄生参数提取、时序分析、压降分析、ESD分析、DRC/LVS、特定电路仿真等。
任职资格:
1.本科及以上学历，电子相关专业，具备良好的沟通协调能力；
2.熟悉CMOS集成电路设计及制造流程；
3.能读懂Verilog语言设计的RTL代码；
4.熟练使用数字后端常用EDA工具，包括DC、ICC、StarRC、PT、Calibre等；
5.熟练使用Perl、TCL、python等一门或多门脚本语言；
6.具有以下条件优先考虑：28nm以上流片经验、懂综合DFT实现、具备ESD设计能力、充分了解封装工艺。
2026-03-30 13:23
IP属地：浙江
职位福利
本科3-5年
工作地址
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