职位详情
任职要求:
具备2年以上逻辑开发经验,掌握VHDL、Verilog语言,了解主流FPGA开发流程;
熟悉常用FPGA芯片及其开发环境,能熟练使用相关逻辑设计与开发工具;
精通Verilog或VHDL语言进行逻辑设计,具备系统级验证与调试能力;
可根据项目需求完成任务拆解与功能实现,具备编写规范的技术文档及用户说明文档的能力
具备2年以上逻辑开发经验,掌握VHDL、Verilog语言,了解主流FPGA开发流程;
熟悉常用FPGA芯片及其开发环境,能熟练使用相关逻辑设计与开发工具;
精通Verilog或VHDL语言进行逻辑设计,具备系统级验证与调试能力;
可根据项目需求完成任务拆解与功能实现,具备编写规范的技术文档及用户说明文档的能力
2026-04-23 12:23
IP属地:陕西西安
职位福利
本科5-10年Verilog

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