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主要方向为高速数据处理与基础算法实现
1、具备高速数据处理及算法实现经历，掌握高速传输接口（如Serdes、高速以太网接口、DDR等）以及低速接口（SPI/UART）的时序特性与设计方法。
2、了解FPGA整体架构，熟练使用至少一种主流FPGA器件的系统结构，熟悉其设计流程、开发模式与调试手段，具有实际上板调试经验，可独立分析并处理调试中出现的技术问题；
3、掌握FPGA时序约束设置、时序路径分析及时序优化策略。
1、具备高速数据处理及算法实现经历，掌握高速传输接口（如Serdes、高速以太网接口、DDR等）以及低速接口（SPI/UART）的时序特性与设计方法。
2、了解FPGA整体架构，熟练使用至少一种主流FPGA器件的系统结构，熟悉其设计流程、开发模式与调试手段，具有实际上板调试经验，可独立分析并处理调试中出现的技术问题；
3、掌握FPGA时序约束设置、时序路径分析及时序优化策略。
2026-09-30 12:55
IP属地：四川成都
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本科3-5年Verilog HDL
四川大能科技有限公司
未融资 · 100-499人
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