成都·青羊区
职位详情
任职要求：
具备2年以上逻辑开发工作经验，掌握VHDL、Verilog语言，了解主流FPGA开发流程；
熟悉常用FPGA器件及其开发环境，能熟练使用相关逻辑设计与开发工具；
熟练运用Verilog或VHDL进行逻辑设计，具备系统验证与调试能力；
可根据项目需求完成任务拆解与功能实现，具备编写规范的技术文档及用户说明文档的能力
具备2年以上逻辑开发工作经验，掌握VHDL、Verilog语言，了解主流FPGA开发流程；
熟悉常用FPGA器件及其开发环境，能熟练使用相关逻辑设计与开发工具；
熟练运用Verilog或VHDL进行逻辑设计，具备系统验证与调试能力；
可根据项目需求完成任务拆解与功能实现，具备编写规范的技术文档及用户说明文档的能力
2026-04-25 12:47
IP属地：四川成都
职位福利
本科1-3年Verilog HDLC语言
中软国际科技服务有限公司
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