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主要职责:
DFT架构与规划: 参与芯片DFT方案的制定,统筹扫描测试(Scan)、存储器内建自测试(MBIST)、边界扫描(JTAG)及逻辑内建自测试(LBIST)等策略的设计与布局。

DFT设计实现:
完成扫描链插入(Scan Insertion)、自动测试向量生成(ATPG)及相关DFT模块(如TAP Controller、OCC)的集成与实现。负责MBIST控制器的设计、集成与验证,覆盖SRAM、ROM、RF等各类存储单元的测试需求。完成JTAG(IEEE 1149.1)与边界扫描结构的设计与落地。

DFT验证: 编写并维护DFT仿真激励,开展布局前与布局后的功能仿真,确保DFT逻辑正确性。协同验证团队推进DFT相关功能的系统级验证工作。

测试向量生成与交付: 产出高覆盖率的ATPG测试向量(涵盖Stuck-at、Transition、Path Delay等故障类型)。生成MBIST与JTAG对应的测试模式。为ATE测试团队提供完整的测试向量、程序文件及相关技术文档支持。

测试支持与良率分析: 协助测试工程师进行芯片调试与测试程序优化。参与量产阶段测试数据的分析与良率提升,定位并诊断测试失效的根本原因。

任职要求:
学历与专业: 微电子、电子工程、计算机科学或相关领域,硕士及以上学位。

经验要求: 具备1年以上DFT实践经验,有成功流片项目经历者优先;入职后由资深专家进行一对一指导培养。

技术要求: 熟悉数字IC前端设计流程,掌握Verilog语言。
深入理解DFT核心技术:Scan/ATPG、MBIST、JTAG/边界扫描。
熟练使用主流EDA工具,例如:
Mentor Tessent(Shell、Ijtag、TestKompress、MemoryBIST)或
Synopsys DFT(DFT Compiler、TetraMAX、BSD Compiler)或
Cadence Modus/Genus DFT
熟悉Unix/Linux操作系统,具备脚本开发能力(Tcl、Perl、Python、Shell之一),能实现流程自动化者优先。
了解半导体制造与测试基础,具有ATE测试协作经验者优先。

软性技能:
具备出色的故障分析与复杂问题处理能力。
拥有良好的沟通协作意识,能与多团队高效配合。
工作态度严谨,责任心强,积极主动,追求高质量交付。
2026-08-18 14:48
IP属地:四川成都

职位福利

硕士1-3年DFTSCAN可测性设计
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成都涌智科技有限公司
20-99人
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