浦东新区
职位详情
岗位职责：
维护并优化数字电路综合流程。
完成数字电路的时序约束设定。
制定timingsignoff规范，并对STA结果进行核查。
生成自研EDA工具所需的timingmodel数据。
协同工作，与RTL设计工程师及数字后端工程师配合，保障设计准确性与项目顺利交付。
岗位要求：
本科及以上学历，计算机工程、电子工程或相关专业。
具备2年以上数字电路综合（SynopsysDesignCompiler）及时序约束实际经验。
熟悉数字电路时序分析及约束文件编写。
掌握Verilog和SystemVerilogRTL语言及其设计流程。
熟悉数字后端实现流程，如ICC2、Innovus、PrimeTime等工具使用。
了解物理设计与布局布线基本原理。
了解DFT设计基础及相关设计需求。
具备脚本开发能力，熟练使用Tcl、Perl等自动化工具。
有FPGA开发经验或高速接口设计（如DDR、PCIe、Ethernet、Serdes）者优先。
具备良好的沟通协作能力，能与团队成员高效配合。
具备较强的問題分析与创新能力，能够提出有效解决方案。
具备良好的英语听说读写能力，可与海外团队顺畅交流。
维护并优化数字电路综合流程。
完成数字电路的时序约束设定。
制定timingsignoff规范，并对STA结果进行核查。
生成自研EDA工具所需的timingmodel数据。
协同工作，与RTL设计工程师及数字后端工程师配合，保障设计准确性与项目顺利交付。
岗位要求：
本科及以上学历，计算机工程、电子工程或相关专业。
具备2年以上数字电路综合（SynopsysDesignCompiler）及时序约束实际经验。
熟悉数字电路时序分析及约束文件编写。
掌握Verilog和SystemVerilogRTL语言及其设计流程。
熟悉数字后端实现流程，如ICC2、Innovus、PrimeTime等工具使用。
了解物理设计与布局布线基本原理。
了解DFT设计基础及相关设计需求。
具备脚本开发能力，熟练使用Tcl、Perl等自动化工具。
有FPGA开发经验或高速接口设计（如DDR、PCIe、Ethernet、Serdes）者优先。
具备良好的沟通协作能力，能与团队成员高效配合。
具备较强的問題分析与创新能力，能够提出有效解决方案。
具备良好的英语听说读写能力，可与海外团队顺畅交流。
2026-06-22 13:32
IP属地：上海
职位福利
本科3-5年3-5年数字后端工程师经验有数字后端工程师经验16nm-7nm低功耗设计经验
苏州异格技术有限公司
天使轮 · 100-499人
工作地址
鱼泡安全保障
如遇到办证收费、刷单、传销、诱导买车等违规行为，请立即向鱼泡直聘投诉举报投诉举报 >
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数字后端工程师3-5年硕士有数字后端工程师经验ASICSoCGPU成功流片经验后端EDA工具英语读写能力3-5年数字后端工程师经验7nm以下TCLPerlPython
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ASIC Physical Design Engineer-综合/STA
2.5-5万元/月
数字后端工程师经验不限硕士STA 逻辑综合 物理设计 PR接受无数字后端工程师经验ASIC成功流片经验量产经验后端EDA工具英语读写能力1年以内数字后端工程师经验1-3年数字后端工程师经验3-5年数字后端工程师经验5年以上数字后端工程师经验7nm以下16nm-7nm45nm-22nmPerlPython
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