海淀区
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任职条件：
（1）具有扎实的编程功底及独立完成开发任务的能力。
（2）熟练掌握 Verilog 语言编写规范。
（3）熟练使用 VCS、Questasim、Verilator 等仿真验证工具。
（4）具备较强的沟通表达能力与团队合作意识。
专业：
微电子、计算机科学与技术及相关专业。
教育水平：
一本及以上本科毕业学历。
相关经验：
（1）有数据处理与数据标注经历者优先考虑。
（2）具备 Verilog 开发实践经历者优先录用。
（3）了解处理器体系架构，熟悉五级流水线、乱序多发射机制者优先。
工作职责：
（1）负责代码验证工作。利用 Verilator、VCS 等仿真平台，构建测试平台（TB）对生成的 RTL 代码进行功能正确性验证。
（2）搭建验证环境。根据具体模块需求，建立基于 UVM 框架的验证系统。
（3）编写 Golden 模块。采用 SystemVerilog 或高级编程语言，实现被测模块的参考模型开发。
知识技能：
（1）精通 Verilog 硬件描述语言，能够实现模块化设计，准确描述数字电路的结构与行为逻辑。
（2）掌握 Python 编程语言的应用开发能力。
考核目标：
（1）Verilog 代码验证通过率达标情况。
拟承担工作：
（1）承担项目中 Verilog 代码的功能验证任务
（1）具有扎实的编程功底及独立完成开发任务的能力。
（2）熟练掌握 Verilog 语言编写规范。
（3）熟练使用 VCS、Questasim、Verilator 等仿真验证工具。
（4）具备较强的沟通表达能力与团队合作意识。
专业：
微电子、计算机科学与技术及相关专业。
教育水平：
一本及以上本科毕业学历。
相关经验：
（1）有数据处理与数据标注经历者优先考虑。
（2）具备 Verilog 开发实践经历者优先录用。
（3）了解处理器体系架构，熟悉五级流水线、乱序多发射机制者优先。
工作职责：
（1）负责代码验证工作。利用 Verilator、VCS 等仿真平台，构建测试平台（TB）对生成的 RTL 代码进行功能正确性验证。
（2）搭建验证环境。根据具体模块需求，建立基于 UVM 框架的验证系统。
（3）编写 Golden 模块。采用 SystemVerilog 或高级编程语言，实现被测模块的参考模型开发。
知识技能：
（1）精通 Verilog 硬件描述语言，能够实现模块化设计，准确描述数字电路的结构与行为逻辑。
（2）掌握 Python 编程语言的应用开发能力。
考核目标：
（1）Verilog 代码验证通过率达标情况。
拟承担工作：
（1）承担项目中 Verilog 代码的功能验证任务
2026-06-25 13:09
IP属地：北京
职位福利
本科1-3年VerilogAIPython
北京远浪信息技术有限公司
不需要融资 · 100-499人
工作地址
鱼泡安全保障
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