海淀区
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工作职责:
1、负责高速图像传感器的设计与应用开发；
2、实现基于FPGA的图像预处理算法；
3、开展基于DDR3/4的图像帧存储架构设计与开发；
4、承担高速接口的数据传输机制及通信协议研发；
5、搭建基于脚本的自动化多顶层仿真环境及UVM验证平台；
6、主导机器视觉领域逻辑工程的整体架构规划与实施。
任职资格:
1、硕士及以上学历，具备3-7年相关领域开发与调试经验；
2、熟练掌握FPGA开发、仿真及调试工具，能高效运用其高级功能；
3、精通Verilog语言及其硬件电路实现，具备规范的编码习惯、高质量代码输出能力和高效的编程技巧；
4、精通时序设计与分析技术，可独立完成项目全流程的时序约束设置，具有大量时序问题排查经验；
5、精通逻辑验证与测试流程，能够独立构建大型项目的集成仿真与联合验证环境；
6、深入理解高速收发器、PCIE、高速网络接口的设计与开发，掌握关键设计细节，具备系统稳定性调优经验，了解rdma与nvme协议；
7、精通图像预处理技术实现方案，熟练运用DSP、RAM、LUT等底层资源进行高性能、低功耗优化设计；
8、了解机器视觉或视频处理行业背景，熟悉图像传感器工作原理。
1、负责高速图像传感器的设计与应用开发；
2、实现基于FPGA的图像预处理算法；
3、开展基于DDR3/4的图像帧存储架构设计与开发；
4、承担高速接口的数据传输机制及通信协议研发；
5、搭建基于脚本的自动化多顶层仿真环境及UVM验证平台；
6、主导机器视觉领域逻辑工程的整体架构规划与实施。
任职资格:
1、硕士及以上学历，具备3-7年相关领域开发与调试经验；
2、熟练掌握FPGA开发、仿真及调试工具，能高效运用其高级功能；
3、精通Verilog语言及其硬件电路实现，具备规范的编码习惯、高质量代码输出能力和高效的编程技巧；
4、精通时序设计与分析技术，可独立完成项目全流程的时序约束设置，具有大量时序问题排查经验；
5、精通逻辑验证与测试流程，能够独立构建大型项目的集成仿真与联合验证环境；
6、深入理解高速收发器、PCIE、高速网络接口的设计与开发，掌握关键设计细节，具备系统稳定性调优经验，了解rdma与nvme协议；
7、精通图像预处理技术实现方案，熟练运用DSP、RAM、LUT等底层资源进行高性能、低功耗优化设计；
8、了解机器视觉或视频处理行业背景，熟悉图像传感器工作原理。
2026-06-25 12:38
IP属地：北京
职位福利
硕士3-5年Verilog
中国大恒(集团)有限公司北京图像视觉技术分公司
不需要融资 · 500-999人
工作地址
鱼泡安全保障
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